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數字：
? BTI BCD 轉成整數（16位）
? ITB 整數（16位）轉成 BCD
? BTD BCD 轉成雙整數（32位）
? ITD 整數（16 位）轉成雙整數（32 位）
? DTB 雙整數（32位）轉成 BCD
? DTR 雙整數（32 位）轉成浮點數（32 位，IEEE-FP）
你可以使用下述指令之一，求一個整數的補碼，或改變一個浮點數的符號：
? INVI 對整數求反碼（16 位）
? INVD 對雙整數求反碼（32 位）
? NEGI 對整數求補碼（16 位）
? NEGD 對雙整數求補碼（32 位）
? NEGR 對浮點數求反（32 位，IEEE-FP）
你可以使用以下“改變累加器 1 中的位順序”指令，交換累加器 1 低字中或整
個累加器中的字節順序：
? CAW 改變累加器 1 低字中的字節順序（16 位）
? CAD 改變累加器 1 中的字節順序（32 位）
你可以使用以下任一指令，將累加器 1 中的 32 位 IEEE 浮點數轉換成 32 位
整數（雙整數）。各條指令的取整方法略有不同：
? RND 取整
? TRUNC 截尾取整
? RND+ 向上取整為雙整數
? RND- 向下取整為雙整數
轉換指令
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// 比較累加器 2 中的內容（MD10）是否大于累加器 1 中的內容（ID24）。
// 如果 MD10 > ID24，則 RLO = 1。
比較指令
2-4
2.4 ? R 浮點數比較（32位）
格式
==R，<>R，>R，<R，>=R，<=R
指令說明
使用浮點數（32 位，IEEE-FP）比較指令，可以將累加器 2 中的內容與累加器 1
中的內容進行比較。累加器 1 和累加器 2 的內容都作為 32 位浮點數
（IEEE-FP）。比較的結果以 RLO 以及相關狀態字位的設置來表示。RLO = 1 表
示比較的結果為“真”；RLO = 0 表示比較的結果為“假”。狀態字位 CC 1 和
CC 0 表示“小于”、“等于”或“大于”關系。
狀態字
BR CC 1 CC 0 OV OS OR STA RLO /FC
寫： - x x x x 0 x x 1
RLO 值
執 行 的 比 較
指令
ACCU 2 > ACCU 1
時的 RLO 結果
ACCU 2 = ACCU 1
時的 RLO 結果
ACCU 2 < ACCU 1
時的 RLO 結果
==R 0 1 0
<>R 1 0 1
>R 1 0 0
<R 0 0 1
>=R 1 1 0
<=R 0 1 1
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6 500..549 只支持CPU 固件版本1.2 或以上
表11-2：系統標志區
組態數據塊（CDB）的結構
CDB 由Ethernet Wizard 在STEP 7 Micro/WIN 32 中生成。下表所示為CDB 的結構。
變量存儲器中
的字節偏移
說明數據格式舉例
標題
0-4 模板名稱5 字節 ASCII 16#4350323433“CP243”
5-6 CDB 長度2 個字節，
十六進制
16#006C（108，十進制）
7-8 NPB 長度2 個字節，
十六進制
16#0014（20，十進制）
CP 243-1 工業以太網通訊處理器
11-20
變量存儲器中
的字節偏移
說明數據格式舉例
一般信息
9 內部使用1 個字節，
十六進制
10 內部使用1 個字節，
十六進制
11-12 為STEP 7 Micro/WIN 預留2 個字節，
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